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CMOS-10
NEC(NECエレクトロニクス)のゲートアレイ設計ルール/プロセス。
参考資料
NEC CMOSゲートアレイ｢CMOS-10ファミリ｣の主な仕様
NEC 世界最大規模のシステム・オン・チップを実現する0.25umプロセスASICの発売について 平成9年(1997年)3月10日
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最終更新：2012年09月18日 23:25
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